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Last Updated :2024/03/29

加藤 健太郎

工学部
助教

研究者情報

■ 学位
  • 博士(工学), 千葉大学大学院
■ 研究キーワード
  • 高集積回路
  • ディペンダブルコンピューティング
  • 計算機システム
■ 研究分野
  • ものづくり技術(機械・電気電子・化学工学), 電子デバイス、電子機器
  • 情報通信, 情報学基礎論, 計算機システム

研究活動情報

■ 論文
  • Low distortion sine wave generator with simple harmonics cancellation circuit and filter for analog device testing
    Shogo Katayama; Takayuki Nakatani; Daisuke Iimori; Misaki Takagi; Yujie Zhao; Anna Kuwana; Keno Sato; Takashi Ishida; Toshiyuki Okamoto; Tamotsu Ichikawa; Kentaroh Katoh; Kazumi Hatayama; Haruo Kobayashi
    IEICE Electronics Express, 2023年01月10日
  • Metallic Ratio Equivalent-Time Sampling and Application to TDC Linearity Calibration
    Shuhei Yamamoto; Yuto Sasaki; Yujie Zhao; Anna Kuwana; Kentaroh Katoh; Zheming Zhang; Jianglin Wei; Tri Minh Tran; Shogo Katayama; Keno Sato; Takashi Ishida; Toshiyuki Okamoto; Tamotsu Ichikawa; Takayuki Nakatani; Kazumi Hatayama; Haruo Kobayashi
    IEEE Transactions on Device and Materials Reliability, 2022年06月
  • Revisit to Histogram Method for ADC Linearity Test: Examination of Input Signal and Ratio of Input and Sampling Frequencies
    Yujie Zhao; Kentaroh Katoh; Anna Kuwana; Shogo Katayama; Jianglin Wei; Haruo Kobayashi; Takayuki Nakatani; Kazumi Hatayama; Keno Sato; Takashi Ishida; Toshiyuki Okamoto; Tamotsu Ichikawa
    Journal of Electronic Testing, 2022年02月
  • An Analysis of Time Domain Reed Solomon Decoder with FPGA Implementation
    Kentaro KATO; Somsak CHOOMCHUAY
    IEICE Transactions on Information and Systems, 2017年
  • Time-to-Digital Converter-Based Maximum Delay Sensor for On-Line Timing Error Detection in Logic Block of Very Large Scale Integration Circuits
    加藤 健太郎
    Journal of Sensors and Materials, Vol.27,No.10 pp.933-943, 2015年, 査読有り
  • A Small Chip Area Stochastic Calibration for TDC Using Ring Oscillator
    加藤 健太郎
    Journal of Electric Testing Vol.30-No.6, 2014年12月
  • Analog/mixed-signal circuit design in nano CMOS era
    Haruo Kobayashi; Hitoshi Aoki; Kentaroh Katoh; Congbing Li
    IEICE Electronics Express, 2014年
  • An On-Chip Delay Measurement Technique Using Signature Registers for Small-Delay Defect Detection
    加藤 健太郎
    IEEE Transactions on Very Large Scale Integration Systems, Vol. 20, No. 5, pp. 804-817, 2012年05月, 査読有り
  • Area Reduction Techniques for Embedded Delay Measurement Using Signature Registers
    加藤 健太郎
    鶴岡工業高等専門学校研究紀要,第46号 pp.61~66, 2012年02月, 査読有り
  • 差分によるVLSI回路の遅延測定
    加藤 健太郎
    電子情報通信学会論文誌 D, Vol.J93-D, No.4, 2010年04月
  • 高集積化システムLSIのためのスキャンテスト設計法
    加藤 健太郎
    千葉大学, 2009年03月
  • Design for Delay Fault Testability of Dual Circuits Using Master and Slave Scan Paths
    加藤 健太郎
    IEICE Trans. Inf. & Syst., Vol. E92-D, No.3, 2009年03月
  • Design for Delay Fault Testability of 2-Rail Logic Circuits
    加藤 健太郎
    IEICE Trans. Inf. & Syst., Vol. E92-D, No. 2, 2009年02月
  • Two-Stage Stuck-at Fault Test Data Compression Using Scan Flip-Flops with Delay Fault Testability
    加藤 健太郎
    IPSJ Trans. Syst. LSI Des, Method, Vol.1 pp. 91-103, 2008年08月
  • 環境との相互作用を用いた自律移動ロボットの識別能力の進化的獲得
    加藤 健太郎
    名古屋大学, 1997年03月
■ MISC
  • Error Correction and Self-Calibration of Analogue- Digital Mixed-Signal Integrated Circuits
    Haruo Kobayashi; Kentatoh Katoh
    International Summit on Semiconductors, Optoelectronics and Nanostructures (ISSON2024),, 2024年05月, 査読有り
  • A Fine On-Chip Online Delay Measurement Using a MUX Chain for Failure Prediction and Analysis
    Kentaroh Katoh; Toru Nakura; Xiaoqing Wen; Haruo Kobayashi
    the 7th International Conference on Technology and Social Science ICTSS 2023, 2023年12月, 査読有り
    筆頭著者
  • Low Distortion Sinusoidal Signal Generator with Harmonics Cancellation Using Two Types of Digital Predistortion
    Keno Sato; Takayuki Nakatani; Takeshi Ishida; Toshiyuki Okamoto; Tamotsu Ichikawa; Shogo Katayama; Daisuke Iimori; Misaki Takagi; Yujie, Zhao; Shuhei Yamamoto; Anna Kuwana; Kentaroh Katoh; Kazumi Hatayama; Kobayashi Haruo
    IEEE Int. Test Conf., Oct. 2023, to appaear, 2023年10月, 査読有り
  • A Physically Unclonable Function Using Time-to-Digital Converter with Linearity Self-Calibration and its FPGA Implementation
    Kentaroh Katoh; Shuhei Yamamoto; Zheming Zhao; Yujie Zhao; Shogo Katayama; Anna Kuwana; Takayuki Nakatani; Kazumi Hatayama; Haruo Kobayashi; Keno Sato; Takashi Ishida; Toshiyuki Okamoto; Tamotsu Ichikawa
    7th IEEE Int. Test Conf. in Asia, Shimane, Japan, Oct. 2023, to appear, 2023年09月, 査読有り
    筆頭著者
  • Inductor ESR Compensation for LC Analog Filters
    Misaki Takagi; T. Nakatani; S. Katayama; D. Iimori; G. Ogihara; Y. Zhao; S. Yamamoto; Kobayashi
    32nd International Workshop on Post-Binary ULSI Systems (ULSIWS) Matsue, Shimane, Japan, 2023年05月, 査読有り
  • Design Consideration for LC Analog Filters: Inductor ESR Compensation, Mutual Inductance Effect and Variable Center Frequency
    Misaki Takagi; Takayuki Nakatani; Shogo Katayama; Daisuke Iimori; Gaku Ogihara; Yujie Zhao; Anna Kuwana; Keno Sato; Takashi Ishida; Toshiyuki Okamoto; Tamotsu Ichikawa; Kentaroh Katoh; Kazumi Hatayama; Haruo Kobayashi
    8th International Congress on Information and Communication Technology (ICICT 2023), 2023年02月, 査読有り
  • SAR Time-to-Digital Converter with 1 ps Resolution for LSI Test System
    D. Iimori; T. Nakatani; S. Katayama; M. Takagi; Y. Zhao; A. Kuwana; K. Katoh; K. Hatayama; H. Kobayashi; K. Sato; T. Ishida; T. Okamoto; T. Ichikawa
    8th International Congress on Information and Communication Technology (ICICT 2023), 2023年02月, 査読有り
  • Signal Estimation by Prony's Method for Application to ADC Testing
    Siwei Li; Anna Kuwana; Yuki Yanadori; Shogo Katayama; Keno Sato; Takashi Ishida; Toshiyuki Okamoto; Tamotsu Ichikawa; Kentaroh Katoh; Takayuki Nakatanii; Kazumi Hatayama; Haruo Kobayashi
    2022年12月, 査読有り
  • Effect of the Delay Elements Variation on Time-to-Digital Converter Linearity
    Zhang Zheming; Anna Kuwana; Shogo Katayama; Shuhei Yamamoto; Kentaroh Katoh; Keno Sato; Takashi Ishida; Toshiyuki Okamoto; Tamotsu Ichikawa; Takayuki Nakatani; Kazumi Hatayama; Haruo Kobayashi
    the 11th International∙Science, Social Sciences, Engineering and Energy Conference I-SEEC 2022, the 6th International Conference on Technology and Social Science ICTSS 2022, 2022年12月, 査読有り
  • Time-to-Digital Converter Linearity Calibration with Metallic Ratio Sampling
    Shuhei Yamamoto; Kentaroh Katoh; Zheming Zhao; Yujie Zhao; Shogo Katayama; Anna Kuwana; Keno Sato; Takashi Ishida; Toshiyuki Okamoto; Tamotsu Ichikawa; Takayuki Nakatani; Kazumi Hatayama; Haruo Kobayashi
    the Joint International Conferences of the 11th International∙Science, Social Sciences, Engineering and Energy Conference I-SEEC 2022, the 6th International Conference on Technology and Social Science ICTSS 2022, 2022年12月, 査読有り
  • A Physical Unclonable Function Using Time-to-Digital Converter
    Kentaroh Katoh; Shuhei Yamamoto; Zheming Zhao; Yujie Zhao; Shogo Katayama; Anna Kuwana; Keno Sato; Takashi Ishida; Toshiyuki Okamoto; Tamotsu Ichikawa; Takayuki Nakatani; Kazumi Hatayama; Haruo Kobayashi
    the Joint International Conferences of the 11th International∙Science, Social Sciences, Engineering and Energy Conference I-SEEC 2022, the 6th International Conference on Technology and Social Science ICTSS 2022, 2022年12月, 査読有り
    筆頭著者
  • High Precision Voltage Measurement System Utilizing Low-End ATE Resource and BOST
    Keno Sato; Takayuki Nakatani; Shogo Katayama; Daisuke Iimori; Gaku Ogihara; Takashi Ishida; Toshiyuki Okamoto; Tamotsu Ichikawa; Yujie Zhao; Kentaroh Katoh; Anna Kuwana; Kazumi Hatayama; Haruo Kobayashi
    2022 IEEE 31st Asian Test Symposium (ATS), 2022年11月, 査読有り
  • Evaluation of Code Selective Histogram Algorithm For ADC Linearity Test
    Yujie Zhao; Kentaroh Katoh; Anna Kuwana; Shogo Katayama; Daisuke Iimori; Yuki Ozawa; Takayuki Nakatani; Kazumi Hatayama; Haruo Kobayashi; Keno Sato; Takashi Ishida; Toshiyuki Okamoto; Tamotsu Ichikawa
    2022 IEEE International Conference on Consumer Electronics-Asia (ICCE-Asia), 2022年10月26日, 査読有り
  • Challenges for Waveform Sampling and Related Technologies
    Haruo Kobayashi; Kentaroh Katoh; Shuhei Yamamoto; Yujie Zhao; Shogo Katayama; Jianglin Wei; Yonglun Yan; Dan Yao; Xueyan Bai; Anna Kuwana
    2022 IEEE 16th International Conference on Solid-State & Integrated Circuit Technology (ICSICT), 2022年10月25日, 査読有り
  • Recent Innovation of Waveform Acquisition Methods: Residue Sampling and Metallic Ratio Sampling
    Haruo Kobayashi; Anna Kuwana; Shogo Katayama; Shuhei Yamamoto; Yujie Zhao; Kentaroh Katoh; Yonglun Yan; Koji Asami; Masahiro Ishida
    11th IEEE International Conference on Communications, Circuits and Systems, 2022年05月, 査読有り
  • Innovative Practices Track: Innovative Analog Circuit Testing Technologies
    Chris Mangelsdorf; Manasa Madhvaraj; Salvador Mir; Manuel Barragan; Daisuke Iimori; Takayuki Nakatani; Shogo Katayama; Gaku Ogihara; Yujie Zhao; Jianglin Wei; Anna Kuwana; Kentaroh Katoh; Kazumi Hatayama; Haruo Kobayashi; Keno Sato; Takashi Ishida; Toshiyuki Okamoto; Tamotsu Ichikawa
    2022 IEEE 40th VLSI Test Symposium (VTS), 2022年04月25日, 査読有り
  • Deterministic Path Delay Measurement Using Short Cycle Test Pattern
    Kentaro Kato
    2017 IEEE 26th Asian Test Symposium (ATS), 2017年11月, 査読有り
    筆頭著者
  • A low area calibration technique of TDC using variable clock generator for accurate on-line delay measurement
    Kentaroh Katoh; Kazuteru Namba
    Sixteenth International Symposium on Quality Electronic Design, 2015年03月, 査読有り
  • An on-chip delay measurement using adjacency testable scan design
    加藤 健太郎
    IEEE International Conference on Information Technology and Electrical Engineering 2015要旨集, Chiang Mai, Thailand pp.508~513, 2015年, 査読有り
  • Acceleration of scan-based on-chip delay measurement using extra latches and multiple asynchronous transfer scan chains
    加藤 健太郎
    IEEE International Conference on Information Technology and Electrical Engineering 2015要旨集, Chiang Mai, Thailand pp.514~519, 2015年, 査読有り
    筆頭著者
  • A TDC-Based Online Maximum Delay Analyzer
    K. Katoh; K. Namba
    International Conference of Global Network for Innovative Technology, 2014年12月, 査読有り
    筆頭著者
  • Time-to-digital converter architecture with residue arithmetic and its FPGA implementation
    Congbing Li; Kentaroh Katoh; Junshan Wang; Shu Wu; Shaiful Nizam Mohyar; Haruo Kobayashi
    2014 International SoC Design Conference (ISOCC), 2014年11月, 査読有り
  • Experimental verification of timing measurement circuit with self-calibration
    Takeshi Chujo; Daiki Hirabayashi; Congbing Li; Yutaro Kobayashi; Junshan Wang; Haruo Kobayashi; Kentaroh Katoh; Sato Koshi
    19th Annual International Mixed-Signals, Sensors, and Systems Test Workshop Proceedings, 2014年09月, 査読有り
  • Digital Compensation for Timing Mismatches in Interleaved ADCs
    Ru Yi; Minghui Wu; Koji Asami; Haruo Kobayashi; Ramin Khatami; Atsuhiro Katayama; Isao Shimizu; Kentaroh Katoh
    2013 22nd Asian Test Symposium, 2013年11月, 査読有り
  • Fast Scan-based On-Chip Delay Measurement Using Multiple Asynchronous Transfer Scan Chains
    加藤 健太郎
    IEEE International Test Conference 2013要旨集, Anaheim, U.S. P012, 2013年10月, 査読有り
  • バウンダリスキャンと組み込み再構成可能ハードウェアを用いたSOCのオンラインインターコネクトテスト法
    加藤 健太郎
    電子情報通信学会技術報告,DC-2013-14, pp.25~29, 2013年06月
  • 隣接テスト機構を用いたオンチップ遅延測定法
    加藤 健太郎
    電子情報通信学会技術報告, DC-2013-8 pp.43-48, 2013年03月
  • An Analysis of Stochastic Self-Calibration of TDC Using Two Ring Oscillators
    加藤 健太郎
    IEEE Asian Test Symposium 2013要旨集, Yilan,Taiwan pp.140~146, 2013年, 査読有り
  • 組み込み遅延測定回路を用いた時分割オンチップパス遅延測定のための入力系列データ量削減の1手法
    加藤 健太郎
    電子情報通信学会技術報告, DC-2012-6 pp.7-13, 2012年06月
  • Time-Multiplexed On-Chip Delay Measurement for Dependable High-Speed Digital LSIs
    加藤 健太郎
    第1回IEEE Global Conference on Comsumer Electronics要旨集, Makuhari,Japan pp.737~738, 2012年, 査読有り
  • 半導体集積回路及び半導体集積回路の検査方法(再掲)
    加藤 健太郎
    特願2009-265825,特開2011-113984, 2011年11月
  • A Low Area and Short-Time Scan-based Embedded Delay Measurement Using Signature Registers
    加藤 健太郎
    IEEE International Symposium on VLSI Design Automation and Test 2010要旨集, Hsinchu,Taiwan, 2010年, 査読有り
  • A Low Area On-Chip Delay Measurement System Using Embedded Delay Measurement Circuit
    加藤 健太郎
    IEEE Asian Test Symposium 2010要旨集, Shanghai,China pp.157-162, 2010年, 査読有り
  • 半導体集積回路及び半導体集積回路の検査方法(再掲)
    加藤 健太郎
    特願2007-233346,特開2009-063518, 2009年11月
  • 半導体集積回路(再掲)
    加藤 健太郎
    特願2007-233388,特開2009-063519, 2009年09月
  • A Delay Measurement Technique Using Signature Registers
    加藤 健太郎
    IEEE Asian Test Symposium 2009要旨集, Taichung,Taiwan, 2009年, 査読有り
  • Design for Delay Fault Testing of 2-Rail Logic Circuits
    加藤 健太郎
    Indonessia-Japan Joint Scientific Symposium要旨集 pp.57-62, 2008年09月, 査読有り
  • 遅延故障テスト容易化FF方式の下での2段階テストデータ圧縮法
    加藤 健太郎
    電子情報通信学会技術報告, DC-2007-25, 2007年11月
  • Fault Tolerant SoC Architecture Design for JPEG2000 using Partial Reconfigurability
    Abderrahim Doumar; Kentaroh Katoh; Hideo Ito
    22nd IEEE International Symposium on Defect and Fault-Tolerance in VLSI Systems (DFT 2007), 2007年09月, 査読有り
  • 粗粒度動的再構成可能デバイスのPE部テストのためのDFT
    加藤 健太郎
    電子情報通信学会技術報告, DC-2006-4, 2006年04月
  • Built-In Self-Test for PEs of Coarse Grained Dynamically Reconfigurable Devices
    加藤 健太郎
    IEEE European Test Symposium 2006要旨集, Southampton,U.K. pp.69-74, 2006年, 査読有り
  • Design of on-line testing for SoC with IEEE P1500 compliant cores using reconfigurable hardware and scan shift
    K. Katoh; A. Doumar; H. Ito
    11th IEEE International On-Line Testing Symposium, 2005年, 査読有り
■ 共同研究・競争的資金等の研究課題
  • 動的命令コード符号化を用いたハッキング検出可能車載向けセキュアプロセッサの開発
    日本学術振興会, 科学研究費助成事業, 基盤研究(C)
    鶴岡工業高等専門学校
    2018年04月01日 - 2021年03月31日
  • PRAMの書き込み時間削減に適した符号
    日本学術振興会, 科学研究費助成事業, 基盤研究(C)
    千葉大学
    2015年04月01日 - 2018年03月31日